芯片设计和验证工程师通常要为在硅片上实现的每一行RTL代码写出多达10行测试平台代码。验证任务在设计周期内可能会占用50%或更多的时间。尽管如此辛苦，仍有接近60%的芯片存在功能瑕疵，需要返工。由于HDL仿真不足以发现系统级错误，芯片设计人员正利用FPGA来加速算法创建和原型设计。
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未设置昵称 2023-04-13 17:58:57安全生产隐患排查治理信息化系统软件
PDPI 2022-09-15 15:19:37培养“新工科”人才，安徽工程大学与天马微电子签订战略合作协议
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技术宅 2021-09-10 11:19:06有金属衬底的钢网如何高效设计
分析了SGPIO总线的数据传输机制，用CPLD模拟SGPIO总线协议来实现并行数据的串行传输，并将其与串并数据转换集成芯片进行对比，说明了前者的应用优势，并且指出了其应用场合。采用Lattice Diamond IDE进行了Verilog
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技术宅 2021-09-10 11:19:06有金属衬底的钢网如何高效设计
介绍了AIN薄膜体声波(FBAR)传感器以及信号处理电路的原理,着重设计了传感器的频率检测电路。频率检测电路采用VHDL语言对各个电路子模块编写相应的代码,并利用Quartus9.0完成了仿真。仿真结果表明,相对精度为10-6,达到了预期的设想,满足了FBAR传感器的要求。
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介绍了针对4×128 双色线列探测器而设计的成像电路系统，其硬件电路主要包括探测器适配电路、视频模拟信号调理电路、模数转换电路、图像预处理电路、数字图像输出接口电路等。探测器驱动时序、一维扫描成像时序、AD 采样时序和接口时序由FPGA 来实现，采用VHDL 语言完成时序设计。
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串行通信接口是一种应用广泛的通信接口。目前，大部分处理器都集成了支持RS一232接口的通用异步收发器，本文基于FPGA开发板设计了一个串口数据采集和处理程序，介绍了用Verilog HDL硬件描述语言来开发波特率发生器、接收模块和发送模块这三个模块，以及系统各个模块的具体设计方法和原理，用Quartus II软件进行仿真并给出结果，分别验证各个模块的正确性及用FPGA实现串行通信的可行性。
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在详细阐读SDRAM数据文档的前提下，参考ALTERA公司的IP core,利用可编程器件（CPLD,FPGA）设计了一种通用的SDRAM控制器。它具有很高的灵活性，可以方便地和其它数据采集分析系统中。在该系统中，以SDRAM存储阵列缓存中频来的高速数据。存满后，数据被慢速读出至数据处理模块。
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此书是关于各种DSP的FPGA实现的书，包括DSP算法原理，算法优化，以及FPGA的硬件实现，包括完整的VHDL，Verilog HDL代码！原版教材，市场上没有卖，扫描版，很清晰。
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本书比较系统地介绍了VHDL的基本语言现象和实用技术。全书以实用和可操作为基点，简洁而又不失完整地介绍了VHDL基于EDA技术的理论与实践方面的知识。
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